DPTI - Trabajos de fin de Maestría en Ingeniería de Productos y Procesos

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https://hdl.handle.net/11117/8169

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Examinando DPTI - Trabajos de fin de Maestría en Ingeniería de Productos y Procesos por autor "Alvizo-Flores, Carlos D."

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    Diseño y desarrollo de mecanismo de sujeción y alineación para la instalación de CPU en servidores
    (ITESO, 2024-04) Alvizo-Flores, Carlos D.; Diez-Martínez, Cesar R.; Colorado-Alonso, Francisco J.
    El presente proyecto tecnológico se enfocó en el diseño y desarrollo de un mecanismo anti-ladeo para la instalación de Central Processing Unit (CPU, por sus siglas en inglés), abordando un problema crítico en la industria de la tecnología de la información. A través de un enfoque parametrizado, se exploró el impacto de la posición del mecanismo anti-ladeo en el ángulo de inclinación del CPU durante su instalación. Los análisis de tolerancias realizados permitieron predecir el rango de inclinación posible del prototipo y sentó las bases una metodología que se puede emplear para nuevos y futuros diseños, proporcionando una comprensión más profunda de las variables que afectan su funcionamiento. Con base en estos análisis, se determinaron los ángulos máximos y mínimos permisibles. Además, se desarrolló una metodología sistemática para el diseño de mecanismos anti-ladeo, permitiendo la optimización del diseño en función de las diferentes condiciones de frontera y restricciones específicas. Esta metodología ofrece un marco sólido para abordar problemas similares en la industria, destacando su relevancia y trascendencia disciplinaria. Se reconoce que existen limitaciones en este trabajo, como la escala del prototipo y la naturaleza simulada de los componentes utilizados. Sin embargo, se resalta la importancia de futuras intervenciones para validar estos hallazgos en entornos más cercanos a la realidad. En última instancia, este trabajo contribuye significativamente al avance del conocimiento en ingeniería mecánica y diseño de dispositivos electrónicos, ofreciendo una solución innovadora y escalable para mejorar el rendimiento y la fiabilidad de los CPU en la industria de la tecnología de la información.